三态输出“与非”门电路与上述的“与非”门电路不同,它的输出端除出现高电平和低电平外,还可以出现第三种状态――高阻状态。 下图是TTL三态输出“与非”门电路及其图形符号。 它与前节图比较,只多了二极管D,其中A和B是输入端,E是控制端或称使能端(是另以“与非”门的输出端)。 当控制端E=1时,三态门的输出状态决定于输入端A,B的状态,实现“与非”逻辑关系,即全“1”出“0”,由“0”出“1”。此时电路处于工作状态。当E=0(约为0.3V)时,T1的基极电位约为1V,致使T2和T5截止。同时,二极管D将T2的集电极电位钳位在1V,而使T4也截止。因为这时与输出端相联的两个晶体管T4和T5都截止(不管输入端A,B的状态如何),所以输出端开路而处于高阻状态。
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GMT+8, 2023-4-23 21:34