基本运算电路中,将集成运放看成理想的,而实际的集成运放并非如此。因此,实际工作情况与理想化分析所得的结论之间必然存在误差,即产生了运算误差。
集成运放的AVD和Rid为有限值时,对运算电路将引起误差,现以图1所示的运算放大电路为例来讨论,用图2电路来等效。 由此可列出如下方程
解之可得 其中 当vS2=0,图1即为反相比例运算电路。此时上式变为 通常AVDRidR¢1>>Rf(R¢1+R2+Rid),利用近似公式(|x|<<1时 ),上式可化简为
闭环电压增益 反相比例运算电路的理想闭环增益为 由此可得相对误差 上式说明,AVD和Rid越大,AVF越接近理想值,产生的误差也越小。d<0说明实际值比理想值的绝对值小。按类似方法可以分析同相比例运算电路。 |
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GMT+8, 2023-3-26 06:07